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Sintesi reti sequenziali

Ultimo Aggiornamento: 02/03/2009 14:19
10/02/2009 10:53
 
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Post: 1
Registrato il: 10/02/2009
Città: AGRIGENTO
Sesso: Maschile
Utente Junior
Ciao a tutti sono uno studente di ingegneria infomatica dell'università di Palermo. Voglio farvi una domanda riguardo la sintesi di reti sequenziali(SINCRONE). Dopo aver creato il diagramma di stato e la tabella di verità come faccio a capire quale flip flop è meglio utilizzare per la realizzazione del circuito?
02/03/2009 14:19
 
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Post: 167
Registrato il: 26/10/2006
Sesso: Maschile
Admin
Utente Gold
Scusi il ritardo della risposta; come avra' letto altrove, il forum e'ormai praticamente in disuso, avendo io abbandonato il corso per motivi di salute.
Come si fa a capire quale tipo di flip-flop utilizzare in una rete sncrona? Il criterio tipico per valutare il circuito che vien fuori nei vari casi e' la complessita' circuitale, ossia il numero di componenti e la topologia delle interconnessioni -- tutte cose impoprtantissime quando i cicuiti venivano realizzati in "logica sparsa", molto meno oggi che essi vengono realizzati con FPGA e dispositivi similari. Tipicamente, ossia salvo casi particolari, la maggiore complessita' si ha usando fli-flop D, e una complessita' minore si ottiene usando flip-flop JK perche' i don't care richiesti dalle loro funzioni di eccitazione aiutano a ridurre la complessita' delle reti combinatorie relarive. Non c'e' un metodo deterministico per arrivare alla decisione, conviene provare con entrambi i tipidi flip-flop (ed eventualmente anche con flip-flop T) e scegliere poi il risultato migliore.
[Modificato da pma 02/03/2009 14:20]
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